Stage-Vérification Uvm d'Ips Digitales pour Cible Asic - Soc - Fpga H/F

Pour faire face au défi que constitue la vérification d'ASIC/SoC toujours plus complexes, l'industrie du semi-conducteur converge vers l'adoption universelle d'une méthodologie de vérification baptisée UVM.

Cette méthodologie favorise la modularité, la réutilisabilité et l'extensibilité.

Elle se base sur des techniques résumées sous les termes de « programmation orientée objet », « Self-Checking Verification Environment », « Constraint Random Tests» et « Coverage/Metric Driven Verification ».

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